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薄膜电容CL21-100V-685J

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产品用途及特点:

适用于旁路、隔直和耦合、滤波,低脉冲线路,无感结果容量范围宽,体积小,自愈的性能好,寿命长等特点。

● 符合RoHS指令

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产品参数 / Product Details

  • 【产品型号】CL21-100V-685J
  • 【所属分类】CL21薄膜电容
  • 【本体高度】25mm
  • 【电容量】6.8μF
  • 【本体厚度】22mm
  • 【容量编号】685
  • 【本体宽度】14mm
  • 【主要材料】金属化聚乙脂
  • 【额定电压】100VDC
  • 【引线间距】22.5mm
  • 【测试电压】1800VDC
  • 【引线长度】3-22mm
  • 【标准偏差】J(±5%)
  • 【引线直径】0.8mm
  • 【损耗角正切】tanδ≤0.0010 1KHz
  • 【绝缘电阻】IR≥15000MΩ IR≥6000S(MΩ/μF)
  • 【温度范围】-40℃~+110℃
如需了解其它参数请通过右侧电话或者微信 QQ咨询

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为更好的解决薄膜电容频率高,总线周期特别快的情况,为增加系统的抗电磁干扰能力采取如下措施:


1、减小信号传输中的畸变:


微控制器主要采用高速CMOS技术制造。信号输入端静态输入电流在1mA左右,输入电容10PF左右,输入阻抗相当高,高速CMOS电路的输出端都有相当的带载能力,即相当大的输出值,将一个门的输出端通过一段很长线引到输入阻抗相当高的输入端,反射问题就很严重,它会引起信号畸变,增加系统噪声。当Tpd>Tr时,就成了一个传输线问题,必须考虑信号反射,阻抗匹配等问题。瓷谷电子认为,信号在印制板上的延迟时间与引线的特性阻抗有关,即与印制线路板材料的介电常数有关。可以粗略地认为,信号在印制板引线的传输速度,约为光速的1/3到1/2之间。微控制器构成的系统中常用逻辑电话元件的Tr(标准延迟时间)为3到18ns之间。


当信号的上升时间快于信号延迟时间,就要按照快电子学处理。溥膜电容厂家认为此时要考虑传输线的阻抗匹配,对于一块印刷线路板上的集成块之间的信号传输,要避免出现Td>Trd的情况,印刷线路板越大系统的速度就越不能太快。


2、选用频率低的微控制器:


选用外时钟频率低的微控制器可以有效降低噪声和提高系统的抗干扰能力。同样频率的方波和正弦波,方波中的高频成份比正弦波多得多。虽然方波的高频成份的波的幅度,比基波小,但频率越高越容易发射出成为噪声源,微控制器产生的最有影响的高频噪声大约是时钟频率的3倍。


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